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【技术共享】射频板PCB设计的经典案例分析,不容错过!

编辑: pcb 2018-12-11


PCB网城讯 今日分享一篇关于射频板PCB的设计的规则和经典案例,可不要错过哦!


一、射频板PCB布局


(一)射频板PCB布局原则


 1. 布局确定:布局前应对单板功能、工作频段、电流电压、主要射频器件类型、EMC、相关射频指标等有详细了解,并明确叠层结构、阻抗控制、外形结构尺寸、屏蔽腔和罩的尺寸位置、特殊器件加工说明(如需挖空、直接机壳散热的器件尺寸位置)等。


另外还应明确主要射频器件功率、散热、增益、隔离度、灵敏度等指标以及滤波、偏置、匹配电路的连接,对功放电路还应得到器件手册推荐的匹配走线要求或射频场分析软件仿真得到的阻抗匹配电路指导。


2. 物理分区:关键是根据单板的主信号流向规律安排主要元器件,首先根据RF 端口位置固定RF 路径上的元器件,并调整其朝向以将RF 路径的长度减到最小,除要考虑普通布局规则外,还须考虑如何减小各部分间相互干扰和抗干扰能力,保证多个电路有足够的隔离,对于隔离度不够或敏感、有强烈辐射源的电路模块要考虑采用金属屏蔽罩将射频能量屏蔽在RF 区域内。


3 电气分区:布局一般分为电源,数字和模拟三部分,要在空间上分开,布局走线不能跨区域。并尽可能将强电和弱电信号分开,将数字和模拟分开,完成同一功能的电路应尽量安排在一定的范围之内,从而减小信号环路面积。


(二) 射频板PCB布线原则


1. 尽可能将数字电路远离模拟电路,确保射频走线参考大面积地平面,并尽可能将射频线走在表层上。


2. 数字、模拟信号线不跨区域布线,如果射频走线必须要穿过信号线,优选:在它们之间沿着射频走线布一层与主地相连的地;次选,保证射频线与信号线十字交叉,可将容性耦合减到最小,同时尽可能在每根射频走线周围多布一些地,并连到主地。


一般,射频印制线不宜并行布线且不宜过长,如果确实需要并行布线,应在两条线之间加一条地线(地线打过孔,确保良好接地)。射频差分线,走平行线,两条平行线外侧加地线(地线打过孔,确保良好接地),印制线的特性阻抗按器件的要求设计。


3. 射频印制电路板布线的基本顺序:射频线路→基带射频接口线(IQ 线)→时钟线→电源部分→数字基带部分→地。


4. 考虑到绿油会对微带线性能、信号等方面有影响,故建议频率较高单板微带线可以不涂覆绿油,中低频率的单板微带线建议涂覆绿油。


5. 射频走线通常不打孔,如必须RF 走线换层,应该将过孔尺寸减到最小,这样不仅可以减少路径电感,并可减少RF 能量泄漏到叠层板内其他区域的机会。


6. 双工器、中频放大器、混频器总有多个RF/IF 信号相互干扰,RF 与IF 走线应尽可能走十字交叉,并在它们之间隔一块地。


7. 除特殊用途外,禁止RF 信号走线上伸出多余的线头。


8. 基带射频接口线(IQ 线)布线应该较宽一些,最好在10mil 以上,为避免相位误差,线长尽可能相等,且尽可能间距相等。


9. 射频控制线要求走线尽可能短,依据传输控制信号器件的输入输出阻抗来调整布线长度,减少噪声引入。走线远离射频信号、非金属化孔和“地” 边缘。走线周围不要打地过孔,防止信号通过过孔耦合到射频地。


10. 尽可能将数字走线、电源走线远离射频电路;时钟电路和高频电路是主要干扰和辐射源,一定要单独安排、远离敏感电路。


11. 主时钟布线要求尽可能短,线宽推荐在10mil 以上,走线两侧包地,以防止其它信号线的干扰。建议用带状线形式走线。


12. 数字、模拟信号线不跨区域布线,如果信号走线必须要穿过射频线,优选分层布线,在它们之间沿着射频走线布一层与主地相连的地平面;次选射频线与信号线十字交叉,频率较低的数字信号可以从大封装电容焊盘之间垂直通过,同时尽可能在每根射频走线周围多布一些地,并连到主地。此外,将射频走线之间的并行长度减到最小可以将感性耦合减到最小。


13. 压控振荡器(VCO)的控制线必须远离RF 信号,必要时可以对VCO 控制线施行包地处理。


14. 在PCB 板的每一层,应布上尽可能多的地,并把它们连到主地面。尽可能把走线靠在一起以增加内部信号层和电源分配层的地块数量。


二、射频板案例分析


(一)原理框图(近端射频单元)



单板整体布局



(二)原理框图(远端射频单元-RRU)



单板整体布局



(三)设计注意事项


1. 两端平行需要拉长,最低距离1.5CM。



2. 偏置电路供电部分与射频线垂直放置。



3. 混频器出来中频率信号应该笔直走线。



4. PI型衰减器布局。



5. 本振电路(LO)按射频信号处理,VCO电路尽量不与射频电路    放置在同一面。



6. 高速差分时钟信号尽量布在内层,有完整的参考地平面。



7. VCM为模拟输入的共模电平偏置输出。该引脚应通过一个0.1uF电容去耦至地。信号走线加粗包地处理。



8. 射频信号包地。



来源:高速射频互联专家


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